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睿思芯科欢迎你的加入!
为公司基于RISC-V CPU内核的机器学习ASIC芯片设计RTL
微架构及实现
能够在功能、性能、功率和面积需求之间作出合理权衡
参与设计和代码审查
优化芯片的时钟及功耗
为模拟仿真过程中的芯片功能和性能调试提供支持
为RTL设计编写计时和功耗限制
电子、计算机、物理、数学等相关理工科专业,硕士或博士学历
良好的Python/Perl/Tcl脚本编写能力
具备功耗优化相关知识
对RISC-V指令集、CPU体系架构、存储器分级体系有所了解将优先考虑
熟悉pipeline设计原理
熟悉仿真技术为佳,如Zebu,FPGA
英文听说读写能力熟练
优秀的学习能力、责任心和团队协作能力
有跨地域、跨时区, 跨语言协作经验的优先考虑
应用先进的芯片验证方法和技术,对芯片的设计、架构及微架构进行验证
定义验证范围,支撑验证框架架构开发工作
参与设计与代码审查
协同公司芯片架构工程师、设计工程师、软件工程师,共同完成验证目标
本科以上学历,硕士、博士更优;电子、计算机、物理、数学等相关理工科专业
具备使用随机激励、功能覆盖、基于断言验证方法的经验
具备使用C++或SystemVerilog的面向对象编程能力
对主流设计及验证工具(VCS 或相近仿真工具、Verdi、GDB等调试工具)及方法(如UVM等)有所了解
熟悉硬件加速仿真技术为佳,如Zebu,FPGA
善于进行调试验证和找寻复杂问题的解决方法
英文听说读写能力熟练
优秀的学习能力、沟通能力、责任心和团队协作能力
有跨地域、跨时区、 跨语言协作经验的优先考虑
负责芯片的研发和设计工作;
和相关部门紧密合作,完成从产品定义,架构定义,逻辑设计,物理设计,验证,流片和量产的全流程;
领导和完成IP模块,子系统和SOC层的设计,集成;
理解客户的芯片需求及应用场景,制定相关数字模块的设计规格;
负责研发团队的日常管理、培训及团队建设。
电子、计算机、物理、数学等相关理工科专业,硕士或博士学历;
具有五年以上RTL设计或者验证经验或者SoC 顶层集成经验;
具有三年以上带领研发团队的经验;
具备参与大型SoC或ASIC工作经验;
熟悉在Git工作环境中进行协同开发的工作经历优先;
具有RISC-V相关知识及经验;
了解CPU架构和内存层次结构;
熟悉设计全流程以及上下游协作;
有跨地域、跨时区、跨语言协作经验的优先考虑。
基于公司硬件平台,为用户提供开发、移植应用程序的技术方案支持
评估优化用户应用程序的性能及功耗
协同系统工程师调试软硬件系统
在硬件设计和芯片架构方向提供反馈及改进建议
本科及以上学历,计算机、电子、软件、自动化等相关工科专业
五年以上相关行业经验
具备低级系统相关知识,包括启动过程、设备初始化、设备通信(包括DMA)、设备驱动程序、程序链接和加载以及功耗
具备Linux内核及编译器的相关知识
具备软硬件协同开发的相关知识
具备C/C++的优秀编程能力
具备机器学习相关领域知识的将优先考虑
具有Python/Shell的脚本编写能力
英文听说读写能力熟练
优秀的自我驱动能力;能够在压力下多线程工作并确定优先级
优秀的学习能力、责任心和团队协作能力
有跨地域、跨时区, 跨语言协作经验的优先考虑
基于公司硬件架构编写和调试深度学习模型、机器学习算法,熟悉Tensorflow,Caffe,Pytorch等实现
有过Neon,CUDA, DSP 等程序优化经验,有过汇编编程经验
对模型在时延、数据吞吐、功耗、内存占用等方面进行优化
对公司硬件使用的Linux系统在功耗、性能、内存占用等方面进行优化
对公司软件构建建立单元测试和连续系统集成测试的测试框架
协助设计和编写模型编程、更新、监测和调试的API
同软件团队一道向硬件功能设计提出建议,使其对目前和未来的软件运行提供更好支持
本科及以上学历,计算机、电子、软件、自动化等相关工科专业
熟练掌握C、C++、Python.
具有Linux 编程经验及计算机操作系统相关知识
具有软件性能测试优化相关经验
具有软硬件协同开发知识
具备功耗优化相关知识
英文听说读写能力熟练
优秀的自我驱动能力;能够在压力下多线程工作并确定优先级
优秀的学习能力、责任心和团队协作能力
有跨地域、跨时区, 跨语言协作经验的优先考虑
负责DFT方案设计,包括测试结构定义、SCAN、MBIST、JTAG、ATPG等测试电路的产生与数据交付;
负责SDC时序约束文件产生;
负责DFT测试的仿真验证,交付测试向量,诊断测试故障,提升测试良率;
负责定义和提供具有竞争力的DFT方案,提高覆盖率、优化测试成本、降低测试功耗。
微电子、电子工程、计算机或相关专业硕士毕业,3年以上工作经验;
熟悉DFT测试原理及工作流程,熟悉DFT时钟复位方案,掌握DFT设计技术(scan、ATPG、mbist、jtag等),参与过大型芯片的DFT设计优先;
掌握DFT相关仿真验证与分析技术,能够指导完成DFT时序收敛,有全芯片SDC验证收敛工作经验优先;
具有分析、追踪和解决覆盖率损失、ATE测试失效等问题的能力,有过支持ATE良率分析工作经验优先;
熟悉Unix/Linux环境,掌握Perl/Tcl/Shell等编程语言,熟练使用主流DFT EDA工具,参与过DFT自动化流程和平台开发等工作优先;
具有较强的团队协作与沟通能力、较强的分析与解决问题的能力,较强的工作主动性。
高性能计算芯片工具链研发,包括compiler/assembler/linker等;
高性能计算芯片编程模型,编程库的设计与实现;
RISC-V架构的代码生成和软流水优化;
高性能计算芯片的性能测试,分析和调优。
计算机、电子工程、通信工程、自动化等相关专业本科以上学历;
5年以上软件研发或编译工具链开发经验;
熟悉编译原理、体系结构、熟悉编译、链接流程;
熟悉GCC的代码和结构,能基于开源版本进行二次开发;
熟悉计算机体系结构,对性能优化有深入的理解;
针对目标客户及相关项目,完成LoRa产品方案的问题分析和技术支持,跟踪项目从Design In到Design Win
对客户需求和问题进行总结,不断完善公司的Reference Design与系统软件栈,为公司产品的可交付性负责
本科及以上学历,计算机、通信、电子自动化等相关专业,5年以上嵌入式软件开发经验
精通LoRa终端模块的协议栈,熟悉网关侧的协议栈者更佳
精通基于ARM或RISC-V的C语言开发,精通ARM或RISC-V等处理器原理。
精通嵌入式操作系统软件开发,能够基于嵌入式操作系统完成协议栈的架构设计、分层、移植和调试
熟悉RTOS/Ucos/Linux或者其他任一款主流嵌入式操作系统
熟悉嵌入式系统的boot loader,能够进行板级系统移植
有高度责任心和敬业精神,较好的专业素养,较强的动手能力,良好的沟通技巧和有团队合作精神
实际做过Soc顶层集成工作
根据产品需求,基于公司RISC-V CPU内核进行SoC的顶层设计和集成。
微架构和实现。
能够在功能,性能,功率和面积要求之间做出合理的权衡
参与设计和代码审查
能够计划和跟踪任务以达到目标日期
ASIC IP集成
优化芯片的时钟及功耗
为模拟仿真过程中的芯片功能和性能调试提供支持
电子、计算机、物理、数学等相关理工科专业,硕士或博士学历
具备使用System Verilog进行RTL设计的经验
能熟练使用python/perl等脚本进行开发工作。
具备功耗优化相关知识
对RISC-V指令集、CPU体系架构、存储器分级体系有所了解将优先考虑
熟悉常见的总线协议,如CHI, AXI,AHB,APB等。有能力进行总线的开发及实现工作。
熟练掌握I2C,SPI,I2S,UART等慢速外设的集成。
熟悉DDR,USB,SDIO等高速外设的集成。
熟悉数字电路的全流程设计,包括从前端文档,RTL设计,验证到后端实现,封装及PCB板的设计,以及回片后的样片测试,能主导/协调解决在全流程设计过程中碰到的实际工程问题。
熟悉仿真技术为佳,如Zebu,FPGA
英文听说读写能力熟练
优秀的学习能力、责任心和团队协作能力
有跨地域、跨时区, 跨语言协作经验的优先考虑
5年以上相关岗位工作经验
负责CPU及RISC-V市场调研分析、竞争分析并形成产品数据手册,具有市场敏感性
对指定细分市场中的竞争产品进行分析,完成benchmark的搜集与深度分析;
发掘并定义新应用场景, 为新应用场景提供供路标及产品定义支持 a)通过对公司产品的理解,客户的需
求,输出符合客户需求的市场产品解决方案;b)通过对公司产品的理解,市场的需求,输出符合市场需求
的售前技术解决方案
在内部向同行和管理层报告并报告技术营销活动的状态,进度和结果。
对指定细分市场中的竞争产品进行分析。撰写和/或整理行业相深度文章及技术分析阐述,以提高公司的声
誉和提高专业知识。
与客户建立关系,理解客户技术需求,为客户应用提供产品解决方案
培训和指导新团队成员的关键技术营销职责。
硕士及以上学历,博士更优,计算机、电子、软件、IT、自动化或其他相似工科专业
丰富的产品及CPU知识和相关的软硬件知识或开发经验,有很强的技术背景,能够深入理解市场热点技术
与先进技术发展方向
具有5年以上MCU产品市场经验,熟悉64/32位MCU产品及相关应用,熟悉工业控制(含电机控制)
逻辑思维强,能够通过数据与市场资料,进行合理的分析与总结
能够跟踪并分析市场热点技术与先进技术发展方向
有很强的客户沟通能力,对行业有很深的理解
具备3年以上基于64/32位嵌入式MCU应用项目研发经验的优先考虑。
有团队合作精神,拥有良好的沟通技能,勤于学习和思考,有创造力和想象力